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Senior Formal Verification Engineer
TechBiz Global GmbH —Tenerife, Santa Cruz de Tenerife provincia
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4d
Técnico/a de Prevención de Riesgos para Servicio de Prevención Propio (SPP)
SGS —Hoya Fría, Santa Cruz de Tenerife provincia
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- Trabajo híbrido
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3D Lead Animator F/M
Atlantis —Santa Cruz de Tenerife, Santa Cruz de Tenerife provincia
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37554/ Técnico/a Superior de PRL especialista Ergonomía - Tenerife
Quirónprevención —San Cristóbal de La Laguna, Santa Cruz de Tenerife provincia
- Jornada completa
- Teletrabajo
- Máster
- Formación continua
- Oportunidades de crecimiento y desarrollo profesional
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Técnico/a de Estudios Eléctricos Media y Baja Tensión
Iplan Group —Santa Cruz de Tenerife, Santa Cruz de Tenerife provincia
- Trabajo híbrido
- AutoCAD
- Microsoft Office
- Ingeniería eléctrica
- Oportunidades de crecimiento y desarrollo profesional
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Senior Data Engineer
Evolved Ideas Spain —Comunidad Autónoma de Canarias
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3d
SAP BW Consultant (m/f/d)
Zoi —Las Palmas de Gran Canaria, Las Palmas provincia
- Jornada completa
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Lighting Artist - Senior level F/M
Atlantis —Santa Cruz de Tenerife, Santa Cruz de Tenerife provincia
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Desarrollador/a Java - Canarias
NTT Ltd —Las Palmas de Gran Canaria, Las Palmas provincia
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Ingeniero/a junior para obras
Bureau Veritas —Las Palmas de Gran Canaria, Las Palmas provincia
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System Service Technician
ABB Robotics Ibérica, S.A.U. —Las Palmas de Gran Canaria, Las Palmas provincia
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- Controladores lógicos programables
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Tax Manager (Malta)
TechBiz Global GmbH —Tenerife, Santa Cruz de Tenerife provincia
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Especialista en Relaciones Laborales
Domingo Alonso Group —Las Palmas de Gran Canaria, Las Palmas provincia
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3d
Senior Middle Level DevOps Engineer
Kentech S.L.U. —Las Palmas de Gran Canaria, Las Palmas provincia
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SAP EWM Consultant (m/f/d)
Zoi —Las Palmas de Gran Canaria, Las Palmas provincia
- Jornada completa
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Compositor mid de efectos visuales (VFX)
Free Your Mind —Las Palmas de Gran Canaria, Las Palmas provincia
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JEFE/A DE OBRA EDIFICACION
COMSA CORPORACION —Las Palmas de Gran Canaria, Las Palmas provincia
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Senior Formal Verification Engineer

TechBiz Global GmbH
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Detalles del empleo

Jornada completa
Hace 4 días

Cualificaciones

Microsoft Word
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Informática
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Bash
Grado
Scripting
Python
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Descripción completa del empleo

At TechBiz Global, we are providing recruitment service to our TOP clients from our portfolio. We are currently seeking a Senior Formal Verification (FV) Engineer to join one of our clients' teams.

Reporting directly to the Vector Unit Verification Lead, this is a highly technical Individual Contributor (IC) role. In this position, you will be the dedicated formal expert for the VU team, responsible for designing scalable formal testbenches, writing mathematical properties, and ensuring the absolute algorithmic and architectural integrity of our vector pipeline. You will work side-by-side with VU microarchitects to hunt down deep corner-case bugs and achieve formal sign-off on high-complexity arithmetic and execution blocks.

Key Responsibilities

Block-Level Execution & Convergence Engineering (90%)

End-to-End Testbench Ownership: Design, deploy, and maintain robust formal verification environments for complex Vector Unit sub-blocks (e.g., Vector Execution Pipelines, Vector Register File/Rename interfaces, and Vector Floating-Point Units).
Datapath & Arithmetic Verification: Implement advanced word-level modeling, bit-blasting, and algebraic rewriting strategies to verify complex IEEE-754 floating-point and integer vector arithmetic units.
Proof Convergence Management: Independently diagnose and resolve proof-convergence failures, over-constraints, and state-space explosions using advanced reduction techniques (e.g., case-splitting, black-boxing, and abstraction modeling).
RISC-V Vector Compliance: Develop formal environments to mathematically prove that the VU pipeline strictly complies with the RISC-V Vector (V) Extension specification.
Simulation Partnership: Collaborate closely with VU simulation engineers to define a razor-sharp boundary between simulation and formal verification, ensuring maximum bug-hunting efficiency and zero coverage gaps.

Embedded Mentorship & Best Practices (10%)

Formal-Friendly Design: Partner with VU microarchitects during early-stage RTL development to drive formal-friendly coding styles and structural design patterns.
SVA Propagation: Review and refine SystemVerilog Assertions (SVA) written by design and simulation peers, establishing best practices for block-level assertions within the VU team.

Education: B.S./M.S. in Computer Engineering, Electrical Engineering, or Computer Science with practical industry execution; or a Ph.D. with a research focus on formal methods or computer arithmetic.
Experience: 5+ years of production-grade hardware verification experience (or Ph.D. + 1–3 years) with a strong, proven track record of applying formal verification to CPU, GPU, or DSP execution pipelines.
Collaboration Style: A self-driven engineer who enjoys deep mathematical puzzles, collaborates seamlessly within a localized block-level team, and can translate complex proof counter-examples into actionable bugs for designers.
Datapath Validation Focus: Strong specialization in arithmetic formal verification, algebraic rewriting, and word-level modeling. Familiarity with control-path formal techniques (liveness, safety properties) is highly welcome.
Vector Microarchitecture: Good working knowledge of high-width execution pipelines, vector execution units, or floating-point/integer arithmetic hardware. Experience with Out-of-Order execution mechanics is a plus.
Formal Tools: Proficient command of commercial EDA formal tools (e.g., Cadence JasperGold/DPV, Synopsys VC Formal, Siemens OneSpin) and their specialized mathematical/datapath apps.
Languages: Native fluency in SystemVerilog and SystemVerilog Assertions (SVA). Scripting proficiency (Python, Tcl, or Bash) for testbench automation.

Nice to Have

RISC-V Core Verification.
RISC-V Ecosystem: Familiarity with the RISC-V Architecture, specifically the Vector (V) and Floating-Point (F/D) extension ecosystems.
Emulation platforms (Veloce, ZeBu).
Core/Bus interface protocols (e.g., AXI/CHI).

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